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Memory Maps
Program
X Data
Y Data
$FFFFFF
Internal
$FFFFFF
$FFFF80
$FFF000
Internal I/O
External
$FFFFFF
$FFFFC0
$FFFF80
$FFF000
External I/O
Internal I/O
External
Reserved
Internal
Internal
$FF00C0
$FF0000 Bootstrap ROM
$FF0000
Reserved
$FF0000
Reserved
$018000
External
$00C000
External
Internal
$00C000
External
Internal
$000000
Internal
Program RAM
96 K
$004000
$000000
Reserved
Internal X data
RAM 16K
$004000
$000000
Reserved
Internal Y data
RAM 16K
Bit Settings
Memory Configuration
MS
1
MSW
[1:0]
00
CE
0
SC
0
Program RAM
96K
X Data RAM*
16K
Y Data RAM*
16K
Cache
None
Addressable
Memory Size
16 M
$0000 –
$0000 – $3FFF
$0000 – $3FFF
$17FFF
? Lowest 10K of X data RAM and 410K of Y data RAM are shared memory that can be accessed by the core and
the EFCOP but not by the DMA controller.
Figure 3-3. Memory Switch On (MSW = 00), Cache Off, 24-Bit Mode
DSP56311 User’s Manual, Rev. 2
Freescale Semiconductor
3-11
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